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74ALVCH16841 有两个 10 位 D 型锁存器，每个锁存器都有独立的 D 型输入 以及用于总线导向应用的 3 态输出。每个寄存器的两个部分都受到控制 独立地由锁存使能 （nLE） 和输出使能 （nOE） 控制门控制。 当nOE为低电平时，寄存器中的数据出现在输出端。当 nOE 为高时， 输出处于高阻抗关闭状态。nOE 输入的操作不会影响 人字拖。 74ALVCH16841 具有有源总线保持电路，用于保持未使用或浮动 有效逻辑级别的数据输入。此功能消除了对外部上拉或下拉的需要 电阻。 2. 特点和优势 • 1.2 V 至 3.6 V 的宽电源电压范围 • CMOS低功耗 • 与TTL电平直接接口 • VCC = 3.0 V 时电流驱动 ±24 mA • MULTIBYTE™ 直通式标准引脚架构 • • 所有数据输入都有总线保持 • 输出驱动能力：85 °C 下 50 Ω传输线 • • 符合JEDEC标准： 3 态同相输出，适用于总线导向应用 低电感多个 VCC 和 GND 引脚，可较大限度地降低噪声和接地反弹 • • JESD8-5（2.3 V至2.7 V） JESD8B/JESD36（2.7 V至3.6 V） • ESD 保护： • HBM：ANSI/ESDA/JEDEC JS-001 2 类超过 2000 V • CDM：ANSI/ESDA/JEDEC JS-002 C3 类超过 1000 V
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